【ARMv8/v9 GIC 系列 5.7 -- 中断路由与系统寄存器】


请阅读【ARM GICv3/v4 实战学习 】


Interrupt routing and System register access

在执行AArch64状态时,中断路由到异常级别(Exception Level)是由以下位控制的:

  • FIQs(快速中断请求):由SCR_EL3.FIQSCR_EL3.NSHCR_EL2.FMO控制。
  • IRQs(普通中断请求):由SCR_EL3.IRQSCR_EL3.NSHCR_EL2.IMO控制。

关于 SCR_EL3的详细介绍见【ARMv8 异常模型入门及渐进 2 – ARMv8/v9 寄存器 (SCR_ELn | ELR_ELn | ESR_ELn | CTR | HCR_ELn … 详细介绍】

这种路由还控制了能够访问控制和确认中断的EL1 CPU接口系统寄存器的异常级别。适用于下面内容:

与Group 0中断相关的寄存器

  • ICC_IAR

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